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Marco Danelutto
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Marco Danelutto
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 | 20 nov | 2 | Modello dei costi per la cache. Numero di fault e costo del singolo fault. Politiche di gestione: trattamento delle scritture (con WRITE BACK e WRITE THROUGH) | {{ :informatica:ae:20-11-2017.pdf |PDF}} | |
 | 21 nov | 2 | Prefetching. Flag prefetch e non deallocare per LOAD/STORE. Politiche di gestione delle cache in caso di context switch. Esercizio: stima del tempo di completamento per scorrimento di una ista e di un vettore (con somma dei valori trovati in ciascuna delle posizioni) | {{ :informatica:ae:21-11-17.pdf |PDF}} | Cap. VIII completo |
+| 22 nov | 2 | Esercitazione: calcolo working set, tracce di indirizzi, accessi in cache set associative | {{ :informatica:ae:22-10-17.pdf |PDF}} | |
+| 27 nov | 2 | I/O e gestione delle interruzioni. | {{ :informatica:ae:27-11-17.pdf |PDF}} | IX.1 e IX.2 + cenni IX.3 | |
+| 28 nov | 2 | Forme di parallelismo, misure di prestazioni, cenni alla valutazione come sistemi di code | {{ :informatica:ae:28-11-17.pdf |PDF}} | X.1-3 X.9 X.11 | |
+| 29 nov | 2 | Processore pipeline. Architettura astratta, retroazioni, gestione delle copie di IC e Registri generali, modello di simulazione | {{ :informatica:ae:29-11-17.pdf.pdf |PDF}} **Attenzione** all'errata corrige finale! {{ :informatica:ae:ae29nov17.mp4 |Errata Corrige Video}}| XI.1 XI.2 |  |
+| 4 dic | 2 | Cenni all'implementazione FW di IM, DM, IU ed EU. Processore pipeline con unità di esecuzione slave. Dipendenze EU-EU. Decodifica out-of-order. Tecniche statiche e dinamiche per l'ottimizzazione del codice. | {{ :informatica:ae:4-12-17.pdf |PDF}} | XI.3 XI.5 e XI.8 (senza 8.3). XI.9 (senza 9.4) | |
+| 5 dic | 2 | Processore superscalare. Multithreading. (lezione virtuale, senza presenza in aula) | {{ :informatica:ae:ae5dic17.pdf |PDF}}{{ :informatica:ae:ae5dica.mp4 |H1}} {{ :informatica:ae:ae5dicb.mp4 |H2}} | XI.10 e XI.11 (senza modelli dei costi) | |
+| 12 dic | 2 | Esercizi (pipeline, superscalare, etc. | {{ :informatica:ae:ae12dic17a.pdf |PDF}}{{ :informatica:ae:ae12dic17a1.mp4 |H1}}{{ :informatica:ae:ae12dic17a2.mp4 |H2}} | |
+| 12 dic | 2 | Esercizi ed approfondimenti sui processori paralleli D-RISC | {{ :informatica:ae:12-12-17ae.pdf |PDF}} | |
+| 13 dic | 2 | Esercizi. Cenni alle architetture multicore: cache coherency e strutture di interconnessione | {{ :informatica:ae:13-12-2017.pdf |PDF}} | | |
+|   Fine lezioni   ||||||||
 Non tutte le lezioni riportano i paragrafi del libro che le coprono. In caso di copertura "parziale" di una parte del libro, i relativi paragrafi sono elencati in corrispondenza dell'ultima lezione che tratta l'argomento. Le parti del libro da studiare per preparare l'esame sono comunque tutte quelle elencate nell'ultima colonna.

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